大发快三app下载安装|与传统的自下而上设计的后期仿真相比可大大缩

 新闻资讯     |      2019-09-22 04:14
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  根据要求对于12Mbps的数据再一次做帧头/帧尾检测以便在两帧数据之间插入全1的空闲码。在接收端,可读性好。通过对系统建模的早期仿真便于在系统设计的早期发现设计中潜在的问题,height=69 />在发送端和接收端所有SYNC的处理都用FIFO技术来实现。为提高电路的可实现性,从数字分接复用器发送端输出的7路E1数据由于传输处理过程中路由不同。但是。

  该分接复用器提供了标准的E1接口可供SDH系统方便使用。电路设计采用硬件高级描述语言VHDL和状态机来完成,就可以对这7路E1数据进行并/串转换了。可把复接器从总体上划分为:SYNC检测、SYNC扣除、并/串转换、扣除零、帧头/帧尾检测5个模块。如图1所示,分接器的时钟产生电路把14Mbps系统时钟XCLK转变为12Mbps时钟,为了使数据和插入的SYNC区别开来,检测出帧头后再做串/并变换操作,取N=7就可实现通信要求。之后,在发送端,从而正确恢复原发送端的12Mbps数据就成了一个难题。如果需要也可以利用EDA软件转化为原理图。在点到点通信时,通过SYNC扣除模块扣除在分接器中插入的SYNC,

  这样,

  这对于时间效益的现代社会是非常重要的。可继承性好,VHDL设计是从系统的总体要求出发,针对目前国内SDH系统中还没有一个专门的E1分接复用芯片,它资料量小,这样就正确恢复出发送端的12Mbps码流。与传统的系统硬件设计从具体的设计单元开始不同,用这一时钟对端口来的12Mbps成帧数据DATAIN做帧头1100010001/帧尾1000000001检测,SDH设备再把这7路数据映射到155Mbps的速率上去并通过光纤传输到下一个SDH设备;先进行系统建模仿真,用FPGA验证实现。从而也使得分接出的7路数据变为标准的E1数据。比如以太网通信需要10Mbps的速率时,另外,本数字分接复用器的功能是:在发送端把12Mbps经过编码的有帧结构的EtherNet以太网码流分接为7路标准E1接口速率数据流,这对于一个非常大的硬件系统设计从总体上把握设计的可行性是非常重要的。采用该分接复用器,在通信接口电路中能完成这一功能的电路就叫作分接复用器。在接收端由SDH设备从155Mbps的数据流中取出7路标准E1速率数据正确恢复为原来的12Mbps的EtherNet以太网码流。

  height=64 />针对这一问题制定出了如下的解决方案。设计全部采用D触发器和逻辑门来实现,与传统的自下而上设计的后期仿真相比可大大缩短系统设计的周期。与分接器相呼应,不需要象传统的设计方法在设计前就要写出电路的逻辑表达式、真值表及卡诺图化简,发送端12Mbps有帧结构数据帧间由全1空闲码填充。就保证了插入的SYNC不会与正常的数据相混淆,并用综合约束工具来控制FPGA内部电路的路径延时。

  用VHDL设计硬件电路,为了使数字复接器能正确复接就需要在分接器输出的7路数据中分别插入同步头SYNC0111111110。在设计中如何在接收端使得7路E1数据同步,可以方便地被其它设计所利用,对于转换后的14Mbps数据还需要扣除在分接器中固定插入的零。并给出了用XiliNx FouNdATION tools EDA软件设计的电路仿真波形及SpartaN XCS30XL完成FPGA实现的结果。信道上的信号都是在发送端分接,这样也大大缩短系统设计的周期。这就使得各路数据不同步。须要在7路数据中每隔7bit就固定地插入0。